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1 院（系）名稱 班 別 姓名 專業名稱 學號 實驗課程名稱 EDA 技術與應用 實驗項目名稱 4-16譯碼器電路的設計 實驗時間 實驗地點 實驗成績 指導老師簽名 【實驗目的】 1. 了解 QuartusII 中電路圖輸入和 VHDL 程序輸入方式。 2. 掌握基于 FPGA 的 4-16 譯碼器電路的設計方法。 【實驗元器件和模塊】 元器件：按鍵、發光二極管 模塊： 4-16 譯碼器 decoder4_16 模塊 【實驗步驟】 首先要建立設計項目，然后在 Quartus II 集成環境下，執行“ File ”菜單的“ New”命令， 或者直接按主窗口上的“創建新的文本文件”按鈕，在彈出的新文件類型選擇對話框中，選擇 “ VHDL File ”，進入Quartus II 的 VHDL 文本編輯方式。 編輯源程序 decoder4_16.vhd 。 library ieee; use
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針對閃存(flash)因制造工藝的不斷提高而導致其內部數據區隨機錯誤不斷增加的現象,設計并實現一種高速BCH編碼譯碼器,通過BCH編碼技術對flash中的隨機錯誤進行糾錯,以達到錯誤檢測與糾錯的目的。實驗結果顯示優化設計的BCH(4 224,4 096)編碼譯碼器可以工作在25 MHz的工作頻率下,其單頁數據(512 Byte)的糾錯能力從普遍的3 bit提高到15 bit,從而提高了flash數據存儲與讀取的可靠性。
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